Download - Edición del código Podemos usar casi cualquier cosa Bloc de notas de Windows GNU Emacs VIM Set Edit
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Edición de código (II)Edición de código (II)
Edición de código (III)Edición de código (III)
QuartusII el IDE de Altera ISE el IDE de Xilinx IDS el IDE de Atmel
Simulación y bancos de Simulación y bancos de pruebaprueba
Alliance Visualización de ondas con GTKWave
SíntesisSíntesis
Consiste en convertir el código HDL en una descripción de la configuración de las macroceldas de la FPGA y las conexiones que se realizarán entre las mismas.
Cada fabricante proporciona herramientas adecuadas para sus productos.
Xilinx proporciona ISE, que funciona tanto en Widows como Linux.
Transferencia del código a la Transferencia del código a la FPGAFPGA
Cada fabricante proporciona programadores y kits de desarrollo.
Casi todas las FPGA tienen interfaz JTAG, la cual además de programarlas, permite depurarlas.
JTAG consta de 5 líneas de comunicación: 2 líneas para datos. 1 línea de reloj. 1 de selección de modo. 1 de reset (opcional). Todas transimeten en serie. Bajo costo.
Proyectos con FPGA: Tarjeta Proyectos con FPGA: Tarjeta gráfica libregráfica libre
256 MB de RAM 2 salidas DVI Soporte para salida de TV analógica y vídeo. 2 FGPA, una Xilinx Spartan-3 y una Lattice
XP10. Ancho de banda de 1,6GB/s. Bus PCI Equivalente a una ATI 7200.
Proyectos con FPGA: CyclopeProyectos con FPGA: Cyclope
System on a Chip (SOC) Orientado a visión artificial Integra
Procesador Z80 Capturadora de vídeo. Sistema de visión artificial. Salida de vídeo VGA. 2 puertos serie RS232 Controlador programable de 6 servomotores 4kB de ROM
Proyectos con FPGA: Sistema Proyectos con FPGA: Sistema de comunicación segurode comunicación seguro
Basado en FPGA XC4010XL de Xilinx. Comunica dos FPGA por un protocolo serie
asíncrono con datos encriptados. Algoritmo de encriptación similar al DES. Velocidad de transmisión variable. Algoritmo de comunicación reversible: cada
módulo es capaz de encriptar y desencriptar.
Proyectos con FPGA: Open UPProyectos con FPGA: Open UP
Desarrollado por la universidad de Valladolid. Procesador CSIC de 8 bits. 12 bits en bus de direcciones. 32 registros. Direcciona hasta 64kB de RAM. Hasta 256Bytes de RAM interna. Implmentado en una XC4000E de Xilinx. Migrable fácilmente a FPGA de Atmel o Lucent. Licencia GPL.
Proyectos con FPGA: Open Proyectos con FPGA: Open DSPDSP
DSP (procesador digital de señal) de 16 bits. Aplicaciones:
Fitros activos , electrónica de potencia, regulación de motores de CA, convertidores de CC a
CA. 16 Registros de 24 bits. Procesador tipo RISC (17 instrucciones) No tiene pila. Sin interrupciones. Licencia GPL
Opencores.orgOpencores.org
Recopilación de cores bajo GPL. Controladores de pantallas LCD. Receptor de radio FM. Ethernet. Puerto PS2, USB, FireWire. etc.